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    Cómo Evitar Errores de Colocación de Serigrafía en la Fabricación de PCB

    Altium Designer
    |  October 30, 2019

    PCB silkscreen picture

    Si recuerdas los Juegos Olímpicos de 1996, sabrás sobre el fuerte final de Kerri Strug. Completó su segundo y último salto de potro con un tobillo lesionado, dando al equipo de Estados Unidos la medalla de oro y demostrando la importancia de perseverar hasta el final. Y, sin embargo, todos sabemos lo tentador que es relajarse y bajar la guardia al final de un proyecto, incluso en el diseño de placas de circuitos. Una de las últimas cosas que hacemos antes de lanzar un diseño para la fabricación es hacer ajustes a las imágenes de serigrafía y a los designadores de referencia del tablero. Sin embargo, la mayoría de las veces este paso no se realiza con la misma diligencia que el resto del diseño. Esto puede hacer que el diseño sea rechazado por el fabricante y enviado de vuelta al diseñador para su corrección. Veamos algunos de los posibles problemas con la serigrafía de PCB y cómo los diseñadores pueden evitarlos.

    Gymnast on a vault

    Termina fuerte como gimnasta

    ¿Cuáles son los posibles problemas de la serigrafía de la placa de circuito impreso?

    Probablemente te estés preguntando qué puede salir mal, estas son algunas de las repercusiones de no hacer los ajustes finales de serigrafía de PCB antes de enviar tu diseño. 

    Componentes mal representados: si una serigrafía no representa con precisión sus componentes previstos, puede generar confusión para los técnicos que realizan la depuración o las modificaciones. Esto puede incluir una forma que represente incorrectamente el componente asociado o números de pin e indicadores de polaridad que se encuentran en los pines incorrectos. Puedes imaginar el tipo de angustia que sentirán los técnicos de la placa cuando están buscando el lado positivo de una tapa y descubran que los indicadores de polaridad están invertidos.

    Texto de serigrafía no legible: si el texto de serigrafía es ilegible, los técnicos de la junta tardan más en interpretar los designadores de referencia. Esto a menudo se debe al uso de un tamaño de fuente demasiado pequeño para ser legible o al uso del tamaño de ancho de línea incorrecto. Los anchos de línea que son demasiado estrechos no se imprimirán en la pantalla con éxito mientras que los anchos de línea que son demasiado grandes se dispararán y se volverán igualmente ilegibles.

    Designadores de referencia colocados en componentes incorrectos: a veces los designadores de referencia terminan en los componentes incorrectos. Esto puede suceder si se mueve un componente pero no el designador de referencia, o puede ser un error por parte del diseñador. En cualquier caso, los técnicos de la placa que intentan probar la placa terminarán sondeando componentes que no coinciden con lo que ven en el esquema.

    Designadores de referencia colocados de modo que estén cubiertos por componentes ensamblados: también hemos visto muchos ejemplos en los que los designadores de referencia de serigrafía terminan debajo de piezas ensambladas. Esto a veces es inevitable en diseños densos, pero debemos hacer todo lo posible para que no ocurra. Una vez más, imagínate a los técnicos de la placa que luchan por encontrar "C143" en tu diseño cuando el designador de referencia no es visible.

    Tinta de serigrafía que cubre metal o entra en agujeros: la tinta de serigrafía que termina cubriendo el metal expuesto, como pines de montaje en superficie o agujeros pasantes chapados, en realidad puede hacer que una tabla se deba desechar. Además, los elementos de serigrafía que colisionan con otros elementos de serigrafía o serigrafía que termina en el borde de la placa no ayuda a nadie.

    Trabajando con tu fabricante

    El primer paso para evitar este tipo de errores es familiarizarte con las pautas de diseño de serigrafía de tu fabricante de placas de circuito. Te proporcionarán información sobre los tamaños de fuente y los anchos de línea óptimos y mínimos. También podrán darte distancias especificadas para serigrafía a otros objetos, incluyendo metal expuesto y agujeros pasantes chapados. Establecer una buena comunicación con tu fabricante y comprender lo que necesita antes de enviarle un diseño es una clave esencial para reducir los errores de fabricación.

    Yellow sticky note with “Let’s Do This” printed on it

    ¡Hagámoslo!

    ¿Qué puedes hacer como diseñador para minimizar los errores de serigrafía?

    Mira tu diseño con un par de ojos nuevos, como si fueras el responsable de modificar y depurar la placa. Si puedes ver el resultado de la serigrafía de tu diseño a través de un visor separado, ayudará con esta verificación. ¿Puedes ver y leer todos los designadores de referencia? ¿Tienes piezas grandes de recuento de pin marcadas para encontrar el pin 1? ¿Tienes la polaridad correcta indicada en las partes apropiadas? Si no puedes leer e interpretar la serigrafía, puedes estar seguro de que tus técnicos tampoco podrán.

    Finalmente, utiliza los Silkscreen DRC en tu sistema CAD. Asegúrate de verificar la serigrafía sobre el metal expuesto, la serigrafía que entra en los agujeros y los espacios libres de serigrafía para otros objetos y otros elementos de serigrafía. Estos controles pueden salvarte de muchos dolores de cabeza.

    Seamos sinceros; diseñar una placa puede ser muy divertido. De hecho, la ruta final a mano puede ser muy catártica, especialmente después de completar un lugar desafiante y una ruta crítica. Sin embargo, el diseño tiene que estar preparado para los archivos de salida finales y eso puede ser una tarea tediosa y monótona. No es infrecuente que los diseñadores de placas de circuitos impresos presten menos atención a la limpieza de la serigrafía y otras tareas relacionadas con la salida, ya que solo quieren terminar con el diseño y pasar al siguiente proyecto. Pero como un gimnasta olímpico, debes terminar fuerte.

    ¿Quieres más ideas sobre cómo terminar tu diseño con serigrafía DRC? Habla con un experto en Altium.

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    PCB Design Tools for Electronics Design and DFM. Information for EDA Leaders.

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