Elimine Erros nos Seus Esquemáticos com a Verificação de Regras Eletrônicas

Chris Carlson
|  Criada: Fevereiro 21, 2017  |  Atualizada: Novembro 10, 2020

Green Check Marks

Em tempos de crescente complexidade de design e prazos reduzidos, é cada vez mais comum que erros passem despercebidos no esquemático e sejam transferidos para a placa de circuito impresso. Continue lendo para descobrir como identificar e eliminar facilmente problemas no seu esquemático com a Verificação de Regras Eletrônicas no seu PCB em Altium Designer®.

Muitos designers e empresas concentram todos os seus esforços em ter um layout de PCB adequado e, atualmente, em verificar em tempo real as condições mecânicas ao redor. Mas e se o esquemático já contiver erros? Geralmente, há uma revisão humana do layout do PCB, mas em tempos de crescente complexidade de design e prazos reduzidos, é cada vez mais comum que erros passem despercebidos. O que pode ser feito para garantir que nenhum erro no esquemático interrompa seu fluxo de trabalho daqui para frente?

Usando Regras Eletrônicas para Identificar e Corrigir Problemas Precocemente em Seus Projetos

A função de verificação de regras eletrônicas (ERC) em softwares profissionais de design de PCB pode ajudá-lo a encontrar e eliminar erros no esquemático, verificando algumas regras básicas e a 'gramática' subjacente ao design. Ao configurar as regras para realizar verificações específicas à sua regra de design, o ERC identifica problemas para que você possa corrigi-los no início do layout do PCB. Além disso, configurar e executar verificações de ERC leva muito pouco tempo... na verdade, uma fração do tempo que você poderia gastar verificando manualmente o design. Isso permite que você gaste seu tempo projetando, não re-verificando o trabalho.

Uma maneira de usar o ERC é dividir as preferências para esta verificação em duas regiões gerais que cobrem a 'gramática' geral do design esquemático e uma matriz de conexão definindo quais elementos podem ser conectados de que maneira, conforme mostrado abaixo.

electronic rule checking split into grammar checking  ensuring all connections are legal
O ERC é Dividido em Verificação de 'Gramática' e Verificação para Garantir que Todas as Conexões são Legais.

A área de 'gramática' abrange diferentes configurações relacionadas ao uso de barramentos, componentes, documentos, chicotes, redes, parâmetros etc.

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O Altium Designer pode suportar essa forma de trabalho com uma ampla gama de rotinas de verificação configuráveis que podem ser usadas tanto para verificar o esquemático após sua criação quanto ao utilizar a verificação ERC online e em lote ao criar seus dados de produção.

Descubra como reduzir significativamente o tempo que você gasta verificando manualmente erros no seu esquemático com as capacidades de ERC no Altium Designer. Para mais informações, baixe nosso white paper gratuito Verificação de Regras Eletrônicas para Esquemáticos hoje mesmo.

Sobre o autor

Sobre o autor

Chris obteve seu diploma de Bacharel em Ciência em Engenharia Elétrica e Eletrônica pela Universidade Estadual do Oregon em 1993, e trabalhou como engenheiro de projeto nas indústrias Bio-Médica, Controles Industriais, Acionamento de Motores e Defesa. Sua experiência abrange desde o conceito até a pesquisa, desenvolvimento, projeto, documentação, fabricação, engenharia de aplicação e suporte. Ele se juntou à Altium em 2007 e trouxe consigo sua experiência em eletrônica de potência, aquisição de dados e controles.

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