전력 네트워크 관리: 회로 기판 최적의 관행

항상 그렇듯이, 여러분의 생각과 코멘트에 매우 관심이 있을 것입니다. 우리가 이와 관련하여 하는 일이 실제 생활에서 궁극적으로 유용하도록 하는 것이 목표입니다.

먼저, 문제를 제가 보는 방식과 그것을 어떻게 해결해야 한다고 생각하는지 설명하겠습니다.

오늘날 Altium Designer에서, 전력 핀은 일반적으로 전력 사용자를 나타내는 데 사용됩니다. ERC 시간에 다른 핀과 다르게 전력 핀을 처리할 수 있습니다.

그러나, 전체 전력 분배 시스템을 쉽게 식별하고 관리하는 것은 불가능합니다.

결과적으로, 전력이 부족한 구성 요소나 단락(많은 사람들이 밤에 잠을 설치게 하는 것이 분명합니다)과 같은 치명적인 오류를 피하기 위해 더 많은 주의가 필요합니다.

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PCB 설계 수준에서 전력을 분배하는 네트워크 집합을 '전력 네트워크'라고 합니다. 마찬가지로, 전류를 접지로 모으는 네트워크 집합은 또 다른 '전력 네트워크'를 구성합니다.

이러한 각 전력 네트워크 내에서, 외부 전력 자원(전력을 제공하는 전원 또는 접지로의 연결)에 연결되는 고유한 지점이 있습니다. 이 지점에 연결된 네트워크는 진정한 전력 네트워크입니다.

또한, 이러한 각 전력 네트워크 내에서, (전류 제한 저항기, 넷-타이, 퓨즈 등)과 같은 여러 '투명' 구성 요소들이 있으며, 전체 네트워크의 관점에서 볼 때, 하나의 네트워크를 다른 PCB 설계자에게 연결하는 (특정 필요한 특성을 가진) 연결만을 의미합니다.

다음은 인쇄 회로 기판 수준에서 이러한 전력 네트워크의 추상적 표현입니다.

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위의 그림에서, 트레이스 네트워크는 빨간색으로 그려졌으며, 빨간 상자 내의 네트워크는 전체 전력 네트워크를 구성합니다. 이 네트워크 내에서, 전력 네트워크 지시문은 'Main PWR'이라는 네트워크를 실제로 전력이 전달되는 고유한 네트워크로 식별합니다.

넷은 파란색으로 그려졌으며, 파란 상자 내의 PCB 레이아웃 전원 넷은 다른 전체 전원 네트워크를 구성할 것입니다. 이 네트워크 내에서 전원 넷 지시문은 실제로 접지에 연결된 유일한 넷인 'Main GND'를 식별합니다.

각 전원 네트워크에서는 인쇄 회로 기판 상의 전원 넷으로 식별될 수 있는 트레이스 넷이 하나만 있을 수 있습니다. 또한 전원 관련 객체를 포함하는 각 넷은 전원 네트워크의 일부여야 합니다.

인쇄 회로 기판 프로젝트의 회로도에서는 '전원 넷 지시문'이라고 하는 새로운 지시문이 사용 가능해질 것입니다. 주어진 넷에 배치되면 외부 전원 자원에 연결되는 유일한 넷(전원 네트워크 내에서)으로 식별됩니다.

이 새로운 지시문은 쉽게 식별할 수 있도록 이렇게 보일 수 있습니다.

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또한 "Part See-Through"이라고 하는 새로운 회로도 객체가 도입될 것입니다.

동일한 부품의 두 핀 핫스팟을 선택하여 배치하고, 이들을 연결할 것입니다.

그래픽 표현은 이와 유사한 것일 것입니다(이것은 선과 타원 호 객체를 사용하여 그려졌습니다).

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부품 투시도의 색상, 두께, 선 스타일(실선 또는 점선) 및 스타일(호 또는 선)은 제어 가능하며 그래픽적인 측면을 결정합니다. 배치 시, 부품 투시도는 대상 부품과 자동으로 '결합'되어 쉽게 함께 이동할 수 있습니다.

실제로 부품 투시도의 역할은 두 개의 넷을 '두 넷의 그룹'으로 결합하는 것입니다. 따라서, 부품 투시도의 그룹은 전원 넷 지시어와 함께 사용될 때 전체 전원 네트워크를 정의합니다.

넷 타이 구성요소는 기본적으로 완전히 투명할 것입니다.

모든 표준 편집 및 관리 시스템(대화 상자, 검사기, 목록, 쿼리, 스크립트를 위한 매개변수화)은 이 새로운 객체와 필드를 지원해야 합니다.

이러한 요소를 기반으로 시스템은 전원 네트워크에 대한 일부 지능을 수집하고 유용한 방식으로 보고할 수 있습니다.

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새로운 컴파일 오류는 제조된 보드에서 오류로 이어질 수 있는 일관성 없는 상황을 나타낼 수 있습니다.

• PCB 레이아웃 전원 넷에 전원 넷 지시어가 누락되었습니다.
• 전원 네트워크에서 전원 넷 지시어 충돌.
• 전원 넷에 전원 핀이 누락되었습니다.
• 전원이 부족한 로컬 전원 넷.

또한, 풀업 또는 풀다운이 있는 경우 입력 핀에 대한 전원 오류와 드라이버가 없는 입력 핀 오류를 더 지능적으로 처리할 수 있습니다: 관련된 네트가 제대로 선언된 전원 네트워크의 일부인 경우, 이러한 오류를 억제할 수 있습니다.

또한 선언된 전원 네트워크를 기반으로 넷 클래스를 생성할 수 있습니다.

마지막으로 전원 네트워크를 이 목적에 맞게 형식화된 보고서에 정확하게 기술할 수 있습니다.

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전원 네트워크 보고서에는 다음 정보가 포함됩니다:

• 특정 전원 네트워크에 관련된 넷 목록
• 전원 네트워크에 관련된 구성 요소와 그들의 투명 핀 쌍 목록
• 특정 전원 네트워크의 전원 넷에 대한 세부 정보.
• 전체 네트워크 ‘경계 핀’ 목록.

미래에는, 이러한 지능을 전원 네트워크를 기반으로 한 자동 전선 색상 지정(스키마틱 표현 개선을 통해)으로 스키마틱 표현을 개선하는 데 먼저 활용할 수 있지만, 더 중요하게는 PCB 레이아웃 수준에서 전원 네트워크를 쉽게 식별하고 관리하는 데 활용할 수 있습니다. 부분 투명도는 신호 넷에 포함된 감쇠 저항의 길이를 관리하는 것과 같은 다른 목적으로도 사용될 수 있습니다.

그러므로, 이 문제에 대한 제 관점은 이 단계에서 이렇습니다. 일부 부분이 누락되었거나 잘못 배치되었을 수 있습니다는 것을 확신합니다.

예를 들어, 부품의 그래픽 표현, 특히 투명 표현과 파워 넷 지시사항, 그리고 새로운 컴파일 오류 및 보고서에 대한 여러분의 피드백에 특히 관심이 많습니다.

이 정보를 활용할 수 있는 다른 유용한 방법도 있을 수 있습니다. 제가 생각하지 못한 것이라면, 알려주세요.

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마지막으로, ‘파워 넷’이라는 용어(특히 ‘파워 넷 지시사항’에서)에 대해 조금 확신이 서지 않습니다. 일반적으로는 목적에 부합하지만, 조금 더 특별한 느낌이 부족하다고 생각합니다. 더 좋은 제안이 있다면 제시해 주세요!

이 문제에 관여해 주셔서 미리 감사드립니다. 여러분의 참여를 크게 가치 있게 생각합니다.

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