대부분의 설계자들은 전력 무결성 문제가 발생할 때까지 전력 무결성에 대해 걱정할 필요가 있다는 것을 깨닫지 못합니다. 다른 설계자들은 현대 디지털 및 고주파 구성 요소의 요구 사항을 감당할 수 없는 보드를 만들 수 있으며, 그들의 전력 전달 네트워크(PDN)에 도사리고 있는 문제를 인식하지 못할 수도 있습니다. 전력 무결성 설계에 관련된 기본 개념은 잘 알려져 있지만, 전력 무결성에 대한 오해가 많으며, 설계자들은 PDN에서 전력 무결성을 평가하고 검증하는 데 도움이 되는 도구가 필요합니다.
전력 무결성 설계에 관련된 도전 과제는 주로 소음 감소와 낮은 PDN 임피던스를 보장하는 데에 집중됩니다. SPICE와 같은 기본 시뮬레이션 도구는 제대로 사용될 경우 전면 엔지니어링 중에 문제를 식별하는 데 탁월합니다. 일부 작업에는 소음의 직접 시뮬레이션, PDN의 과도 응답 및 PDN 임피던스 스펙트럼이 포함됩니다. PCB 레이아웃이 완료되면, 민감한 회로에서 간섭을 일으키거나 장치가 EMC 자격을 획득하는 데 실패할 수 있는 방사된 방출도 시뮬레이션되어야 합니다.
이 전자책에서, 독자들은 전력 무결성에 영향을 미치는 구성 요소와 레이아웃 선택에 대해 더 깊이 이해하게 될 것입니다. 구체적으로, PDN 임피던스에 영향을 미치는 설계 선택이 검토될 것이며, PDN 임피던스 시뮬레이션을 구현하고 분석하는 방법도 다룰 것입니다. 다루어질 주제에는:
현대 PCB에 대한 PDN 시뮬레이션과 고속 PCB에서 전력 무결성 문제를 분석하는 방법에 대해 더 읽으려면 위의 PDF를 클릭하세요. 원본 전체 내용도 여기에서 읽을 수 있습니다:
PDN 임피던스 분석 및 모델링: 스키마틱부터 레이아웃까지
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SPICE에서의 PDN 임피던스 시뮬레이션 및 분석
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