デジタル設計の密度と複雑さがますます増大する中、設計での決定が電源分配ネットワーク(PDN)の電圧や電流に及ぼす影響について完全に理解することは、これまで以上に困難かつ重要になっています。今日のPCB設計者は、PDNの問題の解決を、物理的な試作を使った設計後の作業として捉えるのではなく、PDNの問題を設計時に正確に特定し解決する方法を必要としています。
Altium Designer®に付属のCST®による電流密度解析ツールPDN Analyzerでは、経験レベルに関係なく、あらゆるPCB設計者にとって親しみやすく直観的なプロセスでPDN解析を行えます。このガイドブックでは、順を追ってPDN Analyzerの初期設定について解説します。物理的な試作に依存せず、設計時 にPDNを快適に最適化できるようになります。
電圧ソースから負荷までの銅箔が十分であることを、今はどのようにして確認していますか? プレーンは、適切な電圧範囲を負荷に提供していますか? 通常のPCB設計プロセスでは、これらの問いへの答えは、しばしばありません。通常、エンジニアは、確立された基準を当てにして、うまく行けばPDN問題を回避できるよう、控えめな値を採用します。このように当て推量に頼っていると、試作で把握しきれない場合、製品の信頼性や評判を 損なう大失敗に至る場合があります。
全ての設計は、基板上のチップに対する適切な電力消費要件を満たす必要があります。この際に最も重要なステップは、DC電源供給に十分な 銅箔を提供することです。電力消費のチェックや最適化が行われないと、IRドロップが発生します。すると、電源やGND-shapeの抵抗によって電 圧が消費され、電圧を最も必要とする負荷まで行き渡りません。(※続きはPDFをダウンロードしてください)
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