Altium Designer - 回路・基板設計ソフトウェア

簡単、効果的、最新: Altium Designerは、世界中の設計者に支持されている回路・基板設計ソフトウェアです。 Altium DesignerがどのようにPCB設計業界に革命をもたらし、設計者がアイデアから実際の製品を作り上げているか、リソースで詳細をご覧ください。

Filter
見つかりました
Sort by
役割
ソフトウェア
コンテンツタイプ
適用
フィルターをクリア
自動ピックアンドプレース機は、汎用回路基板に迅速にコンポーネントを取り付けます。電子および回路基板製造 PCBデザイナーが良い顧客になる方法:製造の観点から 1 min Blog PCB設計者 電気技術者 PCB設計者 PCB設計者 電気技術者 電気技術者 製造サービス会社との強力なパートナーシップは、生産プロセスがスムーズに進むか、コストのかかる遅延が発生するかの違いを意味することがあります。製造者の視点からすると、顧客の特定の慣行が、デザイナーを単なるクライアントから価値あるパートナーへと昇格させることもあれば、見積もりのリクエストが列の後ろに押しやられる原因となることもあります。 PCBデザイナーが最高の顧客となる方法についてのガイドです。これにより、高いレベルのサービスを確保し、製造業者との強固な関係を育むことができます。 製造業者のプロセスと能力を理解する 優れた顧客になるための基本的なステップは、製造業者のプロセスと能力を理解することです。時には、製造業者がどのように運営しているかをより深く理解するために、製造プロセスを経験する必要があります。各製造業者には独自の強みと限界があり、設計要件をこれらと合わせることで、多くの潜在的な問題を防ぐことができます。 設計プロセスの早い段階で製造業者との議論を開始してください。単純なボード以外のものを製造する場合は、製造業者の能力と材料の選択肢を決定する必要があります。設計チームは、メールを送るだけでこの情報をすぐに入手できます。この情報は、製造業者のより広範な DFMガイドラインの重要なサブセットです。これらのガイドラインに準拠した設計は、製造が容易であり、エラーや遅延のリスクを減らすことができます。 明確で完全なドキュメントを提供する 製造業者は、見積もりを提供し、生産を進めるために、ビルド要件に関する完全なドキュメントを必要とします。製造業者には、標準のビルドファイルセットが必要であり、それにはGerberファイル、ODB++、またはIPC-2581のエクスポートが含まれます。エクスポートには、必要なPCBレイヤー(銅、シルクスクリーン、はんだマスク、ドリル図面)をすべて含めてください。 明確で正確なドキュメントは、確認のための行き来を最小限に抑え、プロセスを加速させます。残念ながら、Gerberファイルには、製造を完全に見積もり、進行するために必要なドキュメントのごく一部しか含まれていません。必要な他の重要な情報は以下の通りです: 注記付きの製造図面 ドリル表を示すドリル図面 ドリル図面に一致するNCドリルデータ ボードの形状が特殊な場合は、機械図面が必要になることがあります 完全な 製造ノートを含む製造図面を省略すると( リジッドフレックスPCB製造ノートに関するこのリソースも参照)、製造業者がこれを要求するか、PCB内ですべての製造詳細を指定するよう求められます。 Draftsmanでの完全な製造図面ドキュメント。 完全なドリル表とそれに対応するデータは、製造業者が今後のビルドの処理ニーズを判断するのに非常に役立ちます。NCドリルデータからドリル表を再構築するのではなく、製造ドキュメントパッケージにドリル表とドリル図面を含めることで、製造業者は使用されているドリル、PCB内のドリルヒット数、許容されるドリルサイズの許容差、関与するレイヤーペアを正確に把握できます。 Draftsmanドキュメントでドリルテーブルを生成する方法について、 Altiumドキュメントで詳しく学びましょう。 記事を読む
シグナル・インテグリティ_記事 2 高速PCB設計:信号整合性、EMI軽減、および熱管理の確保 1 min Blog シミュレーションエンジニア シミュレーションエンジニア シミュレーションエンジニア 高速信号の整合性は、現代のPCB(プリント回路基板)設計において重要であり、性能、信頼性、およびコンプライアンスに影響を与えます。高速PCBを設計するには、クロストーク、電磁干渉(EMI)、および熱管理などの信号整合性の問題を管理する必要があります。この記事では、クロストーク、グラウンドプレーン戦略、電磁干渉(EMI)、および熱管理を含む高速信号整合性のいくつかの重要な側面を探り、実用的な洞察と例を提供します。これらの概念をさらに深く掘り下げ、拡張された戦略と詳細な例を提供しましょう。 電磁結合とクロストーク 電磁結合:隣接するトレースの信号は、互いに電磁場を誘導することができ、干渉を引き起こします。この現象は電磁結合として知られており、高い周波数でより顕著になります。例えば、密接に配置された高速データラインを持つPCBを考えてみましょう。あるトレースが高周波のクロック信号を運び、隣接するトレースが敏感なデータ信号を運ぶ場合、クロック信号によって生成された電磁場はデータ信号にノイズを誘導し、データエラーを引き起こす可能性があります。 トレースの近接性:信号トレースが互いに近いほど、クロストークの可能性が高くなります。この干渉を減らすためには、トレース間に適切な間隔を保つことが重要です。例えば、高速イーサネットPCBでは、ペア内の信号整合性を確保するために差動ペアが密接に配線されます。しかし、異なるペア間ではクロストークを防ぐために十分な間隔が保たれます。 高周波信号:高い周波数は、より強力な電磁場を生成し、クロストークを悪化させる可能性があります。信号周波数が増加するにつれて、適切なレイアウトと間隔を確保することがますます重要になります。例として、RF回路設計では信号がギガヘルツ周波数に達することがあります。RF信号トレースを他のデジタルまたはアナログトレースから分離して干渉を防ぐために特別な注意が必要です。 不十分なグラウンディング:不適切なグラウンディングはクロストークへの感受性を高めます。固定された連続的なグラウンドプレーンは、リターン電流のための低インピーダンスパスを提供し、信号干渉のリスクを減少させます。例えば、多層PCBでは、信号層の直下にグラウンドプレーンが配置されます。これにより、リターン電流が明確なパスを持ち、クロストークの可能性を最小限に抑えることができます。 高速デジタル通信分析において使用されるアイダイアグラムは、開いたアイパターンを通じて信号整合性を示し、色のグラデーションが信号密度と性能を示しています。 EMI軽減技術 適切なPCBレイアウト: トレースのルーティングを最適化し、ループ領域を最小限に抑え、グラウンドプレーンを効果的に使用することで、EMIを大幅に削減できます。例えば、高速デジタル設計では、重要な信号トレースをグラウンドプレーンの間に挟まれた内部層にルーティングします。これによりループ領域が最小限に抑えられ、EMIに対する効果的な遮蔽が提供されます。 フィルタリング: フェライトビーズやキャパシタなどのフィルタを実装することで、高周波ノイズを抑制し、EMIを減少させることができます。例えば、フェライトビーズは電源ラインに配置され、高周波ノイズをフィルタリングし、それが敏感なアナログ回路に伝播するのを防ぎます。 コンポーネントの配置: 騒音の多いコンポーネントを敏感なエリアから離して配置し、適切な遮蔽を確保することで、EMIを軽減することができます。例えば、混合信号PCBでは、アナログコンポーネントを一方の側に配置し、デジタルコンポーネントを反対側に配置し、その間にグラウンドプレーンを配置して隔離を提供します。 金属シールド: 騒音の多いコンポーネントを金属シールドで囲むことで、EMI放射を防ぎ、近くの敏感な回路を保護できます。例えば、PCB上のRFモジュールは、電磁放射を含むためにしばしば金属シールドで覆われ、隣接する回路との干渉を防ぎます。 グラウンディングとボンディング: 適切なグラウンディングとボンディングを確保することで、リターン電流の明確な経路を提供し、グラウンドループの可能性を減少させることにより、EMIを最小限に抑えます。例えば、グラウンディングストラップやビアを使用して異なるグラウンドプレーンを接続し、PCB全体にわたってリターン電流の低インピーダンス経路を確保します。 フィルタ設計: 容量性および誘導性フィルタを使用することで、望ましくない周波数を効果的にブロックし、EMIを減少させ、信号の整合性を向上させます。例として、入力ラインに使用されるローパスフィルタは、高周波ノイズをフィルタリングし、敏感なコンポーネントに到達する信号の周波数のみを確保します。 記事を読む
PIMX8 プロジェクト - 第6章 Pi.MX8 プロジェクト - ボードレイアウト パート4 1 min Altium Designer Projects PCB設計者 PCB設計者 PCB設計者 Pi.MX8コンピュートモジュールSoMプロジェクトの新しいインストールメントへようこそ!このアップデートでは、PCB設計に最後の仕上げを行い、プロトタイプの生産準備を整えます。 前回の 記事では、信号層のルーティングを完了しました。これはPi.MX8モジュールのPCBレイアウトで最も時間がかかる部分でした。しかし、同じくらい注意を要する2つのタスクがまだ残っています。電源プレーンのルーティングと信号遅延の調整です。 電源プレーン まず、電源プレーンから始めましょう。私は通常、遅延調整を最後のステップとして行うのが好きです。なぜなら、長さ調整のために必要なメアンダーがボード上の残りのスペースをしばしば埋め尽くすからです。例えば、電源ネットをルーティングする際に追加のVIAを配置する必要がある場合(時には必要になることがあります)、必要なスペースを作るために長さ調整プリミティブを調整する必要が出てくるかもしれません。最後に長さ調整プリミティブで残りのスペースを埋めることで、追加の作業を避けることができます。 利用可能な電源プレーン層 レイヤースタックを見ると、2つの専用の電源プレーン層が利用可能であることがわかります。これらの層は、薄いプリプレグによって隣接するグラウンド層から分離されています。このスタッキングは低インダクタンスプレーンの容量を増加させ、高周波でのPDNインピーダンスを減少させるのに役立ちます。 まず、高電流の電源レールを配線しましょう。この場合、これらはi.MX8 SoCとDRAMコントローラーのコアおよびメモリレール、そしてLPDDR4 ICです。 SoCのPMICコアおよびメモリ供給 VCC_ARMおよびVCC_SOCレールはリモートセンシングを使用しており、これはバックコンバーターのフィードバックノードがMIC近くの出力コンデンサにルーティングされるのではなく、i.MX8の電源パッドにルーティングされることを意味します。これは、電源プレーンまたはポリゴンを通る電圧降下を補償するためです。これらのレールの電流が比較的高く、PMICがこれらの電圧を正確に調整する必要があるため、負荷で直接「電圧を測定」することが重要です。次の図は、電源ポリゴンを通る電圧降下を示しています: 電源ポリゴンを通る電圧降下 VCC_ARMレールのパワーポリゴンは、レイヤー6にルーティングされています。ポリゴンのアウトラインに近くルーティングされたトレースは、リモートセンシング信号です。理想的には、リターンパス電流によって導入される寄生効果を補償し、フィードバックをノイズに対してより耐性を持たせるために、差動電圧を測定したいところですが、私たちの場合、これは必要ありません。参照設計の推奨に従います。 VCC_SOCポリゴン フィードバックトレースは、SoCのピンの近くで「ネットタイ」を使用して、フィードバックネットをパワーネットに接続します。ネットタイを使用しない場合、フィードバックトレースとパワーポリゴンの間のクリーンな分離を手動で確保する必要があります。このアプローチはエラーが発生しやすいです。ネットタイは、両端に小さなパッドを持つ短いトレースセグメントからなるフットプリントです。コンポーネントタイプをネットタイに設定することで、Altium Designerはこのコンポーネントに対してショートサーキットエラーを生成しません。 VCC_ARMポリゴンとDRAMパワーレールは、レイヤー5で同様の方法でルーティングされています。 VCC_ARMが強調表示され、DRAMパワーレールが紫色で表示されています 残りの電源レールは、レイヤー5と6に分配されています。1.8Vおよび3.3Vのシステム電源ポリゴンは、これらのレールに接続されている多くのコンポーネントがボード全体に分散しているため、ボード全体にわたって広がっています。 記事を読む