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プリント基板製造プロセスにおけるガーバーファイルとは? プリント基板製造プロセスにおけるガーバーファイルとは? ごちそう、セーター、それと歓声はさておき、ホリデーパーティーで 本当に一番大事な要素は何でしょう?もちろん、写真を撮ることですよね。そこで私は、ホリデーパーティーの準備をしている時に、携帯電話よりも質の高い写真を撮ろうとHDカメラを取り出しました。しかしカメラを取り出した時、以前に使用して以来、実にどれほどの時間が経っているのか気づいたのです。それに、しばらく使用していないテクノロジーと同じように、画像ファイルをどうやってコンピュータに転送したらいいかをすっかり忘れてしまっていました。 横に隠れたUSBポートが付いていることをすぐに思い出しましたが、おかしな考えが浮かびました。プロセスのバックエンドを理解することなくプリント基板設計の世界に関わっている人のことを想像したのです。CADシステム内のこれらのパッドとトレースは全て、何らかの方法でプリント回路基板に変換する必要があります。私が撮影しようとしていた写真へのアクセス方法を思い出せなかったのと同じように、設計データを製造業者に送ることに何が関わっているのかを理解していない人は、何人ぐらいいるのでしょうか。 設計データを製造業者に渡す最も一般的な方法は、「ガーバー」と呼ばれるファイル形式を使用することです。ホリデーパーティーの最初の数時間をどのように過ごすのか、去年のパーティーのおふざけを回想するのと同じ具合に、ガーバーファイルはちょっとした背景知識があると最適です。ガーバーファイルの由来を知ることで、それがどのように成長してきたか、また将来どのようになるのかについての理解が深まります。そのプロセスと発展を理解した後には、製造業者と設計チームの橋渡し役となるための最適な準備が整っていることでしょう。 プリント基板製造プロセスの最初のステップである、ガーバーファイル CADシステムでプリント回路基板を設計すると、様々なスタイルの線や形状で表される回路基板の金属が表示されます。これらのグラフィック画像は何とかして、基板製造業者が回路基板の作成に使用できるデータに再フォーマットする必要があります。これが、ガーバーファイルの仕事です。 ガーバーファイルは、 4つの要素で構成されているASCII テキストファイルです: 構成パラメータ アパーチャ定義 ドローコマンドとフラッシュコマンドのXY座標値 ドローコマンドコードとフラッシュコマンドコード ほとんどのプリント基板CADシステムは、設計データからガーバーファイルを生成する機能を備えています。スルーホールピンの丸パッドは、いくつかの位置座標と共に、フラッシュコマンドによってガーバーファイル内で表されます。クロックライントレースは、トレースの各頂点に対する一連の座標置と共に、ドローコマンドコードによって表されます。 これらのコマンドコードの理由は、フィルム上に基板レイヤーを作成するプロッタを駆動するように、元々ガーバーファイルが設計されていたためです。このフォトプロッタは、ランプまたはレーザーからの光を使用してフィルムを露光し、それを使用してPCB製造者が必要とするツーリングを作成します。その種々のコードは、光を点滅させるか、光で描写するか、光なしで移動するかのどれかです。また、アパーチャとして知られている光のサイズと形状を決定するためのコードもあります。従来のフォトプロッタは今日もまだ広くつかされていますが、ガーバー情報が回路基板材料上に直接画像化される レーザ直接描画(LDI)技術によって、取って代わられ始めています。 ガーバーファイルによってプリント基板CADシステムから データを取り出し、製造業者に手渡す ガーバーファイルの過去、現在、そして未来 元々のガーバーファイルは、RS-274-Dフォーマットとして知られていました。初期のファイルは、XY座標位置とドロー&フラッシュコマンドのみで構成されていました。基板設計者は、ガーバーファイルの作成プロセス中、手動でアパーチャコードを割り当てる必要がありました。その後、全てのアパーチャデータを構成パラメータと共に個別のファイルに抽出しました。正確なガーバーファイルを作成するには、正確なコードの割り当てに入念に取り組む必要がありました。
電子機器のためのバーンインテストとは何ですか? Thought Leadership 電子機器のバーンインテストとは何ですか? 新しい基板の製造を計画する際には、おそらく新製品に対するさまざまなテストを計画することになるでしょう。これらのテストは、しばしば機能性に焦点を当て、高速/高周波基板の場合は信号/電力の整合性に焦点を当てることが多いです。ただし、製品を極端な期間にわたって動作させることを意図している場合、製品の寿命の下限を信頼性を持って設定するためのデータが必要になります。 インシリキットテスト、機能テスト、および可能な限り機械テストに加えて、部品や基板自体もバーンインテストの恩恵を受けることができます。大量生産を計画している場合、これは大量生産に移る前に行うのが最適です。 バーンインテストとは? バーンインテスト中、特別なバーンイン回路基板上のコンポーネントは、コンポーネントの定格動作条件以上でストレスをかけられ、コンポーネントの定格寿命前に早期に故障する可能性があるアセンブリを排除するために行われます。これらのさまざまな動作条件には、温度、電圧/電流、動作周波数、または上限として指定されたその他の動作条件が含まれます。これらの種類のストレステストは、加速寿命試験(HALT/HASSのサブセット)と呼ばれることがあります。これは、コンポーネントの動作を長期間および/または極端な条件下で模倣するものです。 これらの信頼性テストの目標は、バスタブ曲線(以下に例が示されています)を形成するための十分なデータを収集することです。残念ながら名前のついた「初期故障」部分は、製造上の欠陥による早期のコンポーネントの故障を含みます。これらのテストは通常、高信頼性半導体の上限である125°Cで実施されます。製品の信頼性を完全に把握するために、さまざまな温度で電気的に動作させることができます。 プロトタイプ基板でのバーンインテストおよび環境ストレステストは、意図された基板材料の ガラス転移温度以上の125°Cで実施することができます。これにより、基板の機械的応力による故障に関する極端なデータと、部品の故障に関するデータが得られます。バーンインテストには、次の2種類のテストが含まれます: 静的テスト 静的バーンインは、入力信号を適用せずに各コンポーネントに極端な温度と/または電圧を単純に適用するものです。これは単純で低コストな加速寿命試験です。プローブは単に環境チャンバーに挿入され、チャンバーは温度に達し、デバイスは所望の適用電圧に達します。このタイプのテストは、極端な温度での保管を模倣するための熱試験として最適です。テスト中に静的電圧を適用すると、デバイス内のすべてのノードがアクティブにならないため、コンポーネントの信頼性の包括的な視点を提供しません。 動的テスト このタイプのテストでは、バーンインボードが極端な温度と電圧にさらされながら、各コンポーネントに入力信号が適用されます。これにより、IC内の内部回路が信頼性の観点で評価されるため、コンポーネントの信頼性の包括的な視点が提供されます。動的テスト中に出力を監視することで、基板上のどのポイントが最も故障しやすいかをある程度把握することができます。 どんなバーンインテストでも、故障が発生した場合は徹底的な検査が必要です。特にプロトタイプボードのストレステストではこれが特に重要です。これらのテストは時間と材料の面で時間がかかり、費用がかかることがありますが、製品の有用寿命を最大限に引き出し、 設計の選択肢を適格化するために重要です。これらのテストはインシリキットテストや機能テストをはるかに超え、新製品を限界までストレスをかけます。 ボードレベル対コンポーネントレベルの信頼性テスト バーンインテストは通常、プロトタイプボードのストレステストを指すものではありません。これは通常、HALT/HASSと呼ばれます。バーンインテストは、他の環境/ストレステストと併せて、基板レベルおよび コンポーネントレベルの障害を明らかにすることができます。これらのテストは、仕様どおりに行うことも、指定された動作条件を超えて行うこともできます。 一部の基板設計者は、コンポーネントの仕様を超えたストレステストや基板/コンポーネントの意図しない動作条件でのテスト結果を受け入れることに躊躇するかもしれません。その理由は、基板やコンポーネントが意図された環境で展開される際には決してそのような動作条件にはならないため、テスト結果は無効であると考えられるからです。しかし、これは仕様を超えたバーンインテストやストレステストの本質を見逃してしまっています。 これらのテストを仕様を超えて実行することで、より多くの故障箇所を特定できます。連続して複数のテストを実行することで、これらの故障箇所が時間とともにどのように発生するかを確認し、信頼性のより良い視点を得ることができます。仕様を超えて実行することは、製品の寿命をより大きく加速させ、浴槽曲線のより深い視点を提供します。 もし過剰な仕様のテスト中に特定された不良ポイントに対処できれば、完成した基板の寿命を大幅に延ばすことができます。設計ソフトウェアでサプライチェーンデータにアクセスできれば、より長い寿命を持つ適切な代替部品に簡単に切り替えることができます。これらの手順はすべて、完成品の寿命を延ばすために大いに役立ちます。 製造業者からのバーンインテストの結果を受け取り、設計変更を計画している場合、
SRAMユーザーのためのPCB設計のヒント:データ損失を防ぐ方法 Thought Leadership SRAMとは何か?PCB設計のヒントとデータ損失の防止方法 SRAMは電源が切れるとデータを失います。 編集ソフトウェアの最高の発明の一つは、最悪のタイミングでマーフィーの法則が発動するのを防ぐオートセーブ機能です。数十年前、オートセーブ機能が存在しないことが、「保存」ボタンを押すことを渋っていた私にとって悪化し、重要な大学の課題の数ページが文字通り消去されたとき、私はほとんど泣きました。 電子機器では、SRAMを設計する際の課題を認識していないと、静的ランダムアクセスメモリ(SRAM)に格納されているデータ全体を失うリスクがあります。これは、SRAMが重要な変数を格納している場合、特にハードウェアの予測不可能な動作を引き起こす可能性があります。 SRAMとは何か、そしてどのように機能するのか? SRAMは、組み込みシステム設計で一般的に使用される不揮発性メモリです。ロジカルビットで情報を格納し、動作電圧が供給されている限りその値を保持します。電源が切断されると、SRAM全体がデフォルト値、通常はロジック1に相当する値にリセットされます。 SRAMの内部は、複数のセルによって構成されています。これらのセルには、いくつかのトランジスタによって制御されるバイステーブルフリップフロップが含まれています。特定のアドレスに情報が格納されると、いくつかのフリップフロップがデータのデジタル値を表すように適切にラッチされます。 SRAMは電源が切れると情報を保持できないにもかかわらず、追加の作業用メモリが必要な設計で定期的に使用されます。FlashやEEPROMなどの他の揮発性メモリコンポーネントと比較して、SRAMは無視できる読み取りアクセス時間を持ち、データはランダムなメモリアドレスに書き込むことができます。 他の電子部品と同様に、SRAMは年々改良されてきました。SRAMが40ピン以上の大型コンポーネントであり、並列アドレスバスがまだ一般的なインターフェースだった時代は過ぎ去りました。今日のメモリメーカーは、 SPIやI2Cのようなシリアルインターフェースを備えたSRAMを生産し、フォームファクターを8ピンまで大幅に削減しています。 SRAMを設計する際の主要な考慮事項 SRAMの設計にさらなる考慮を払うことで、大きな違いが生まれるかもしれません。 SRAMを使った設計は簡単な作業のように思えるかもしれません。結局のところ、ピン数が少ないメモリチップを使った設計が何が難しいのでしょうか?しかし、経験上、実際には多くの問題が発生する可能性があることを学びました。部品選択から製造後の問題に至るまで、多くの問題に遭遇する可能性があります。ここでは、初心者レベルのPCB設計者に役立ついくつかのヒントを紹介します: メモリ容量 最大容量のSRAMを選ぶべきでしょうか?それともプロジェクトの要件に合ったものを選ぶべきでしょうか?これは、ファームウェア開発者を悩ませる質問であり、ハードウェア設計者にとってはそうではありません。メモリメーカーは通常、同じ物理パッケージで異なる容量のSRAMを導入します。これは、メモリ容量の選択が変わっても設計を変更する必要がないことを意味します。 インターフェースタイプ SRAMでよく使用されるインターフェースにはSPIとI2Cがあります。SPIはデータの書き込みと読み出しに4つの物理ピンを必要としますが、I2Cは2つの物理データ接続のみを必要とします。一般に、SPIはより高速なアクセスを提供しますが、SPIバス上の各ICに個別の制御信号が必要です。I2Cは、複数のメモリチップがマイクロコントローラに接続されている場合に理想的で、データ信号とクロック信号のみが必要です。 デカップリングコンデンサ 革新的な不揮発性メモリー、フラッシュや FRAMのようなものが登場している今、バッテリーバックアップSRAMを設計することはほとんどないでしょう。これにより確かにSRAMの設計は容易になりますが、安定した電源供給の重要性を見落としてはいけません。SRAMのVccピンにできるだけ近い場所にデカップリングキャパシタを配置することを常に確認してください。電源の不安定さによるデータの破損は、絶対に避けたい最後の事態です。 デカップリングキャパシタは、グラウンドバウンスの問題を防ぐのにも役立ちます。
RISC-Vは高度なチップの供給チェーンをどのように変えるのか? RISC-Vは高度なチップの供給チェーンをどのように変えるのか? 革新的な新しい電子機器から最も強力な人工知能(AI)の使用事例に至るまで、先進的なチップは最新技術の背骨を形成しています。現在のイノベーションの速度は、より小さなパッケージでのより多くのパワーにかかっています。 長年にわたり、多くの産業がカスタムチップの設計を追求する専門知識やリソースを持っていませんでしたが、カスタムチップは消費者向け電子機器、コンピューティング、データストレージおよび集約、モビリティなど、さまざまなアプリケーションでの機能の幅広い範囲をもたらすという事実にもかかわらずです。 しかし、そのようなコンポーネントを提供する能力と容量は、主に世界中のいくつかの主要メーカーにあります。一部の国はこの分野で台頭しており、経済がそれに依存しているためにファブの能力を構築していますが、寡占市場は米国、中国、台湾で構成されています。世界中で変化が起こっていますが、権力を持つ者(中国と米国)は、輸入と輸出に関する戦いでその権威を行使しています。 これらの国々が互いに争っている間、部品設計者たちは、開発と製造の取り組みにおける柔軟性の源泉を検討しています。リデュースド・インストラクション・セット・コンピューティング・アーキテクチャの第5版(RISC-V)は、多くの企業にカスタマイズされた半導体製品を大幅に削減されたコストで提供するプラットフォームを提供することができるだけでなく、新しいコンポーネントのための高価なIPライセンスの排除も可能にします。 RISC-Vとは何か? 今日利用可能な2種類のコンピュータ処理ユニット(CPU)構造の間には議論があります。一般的に、高性能チップメーカーのIntelとAMDはx86構造を使用しています。代わりに、複雑命令セットコンピュータ(CISC)の一般的な選択肢であるARM CPUがあります。しかし、無料で使用できるオープンソースソリューションが利用可能になることで、開発者はさまざまなアプリケーションに適応させることができる、より柔軟性の高いプラットフォームを活用することができます。 使い勝手の面で、"RISC-V"(「リスク・ファイブ」と呼ばれる)は、製造業者自身から派生する制約なしに、より革新的なCPUを構節するためのより柔軟なアーキテクチャと見なされています。2014年にカリフォルニア大学(UC)バークレー校によって導入され、現在はRISC-V Internationalという非営利団体が監督しているRISC-Vは、CPUの設計や再検討に必要な要件が少ないという特徴があります。RISC-Vを従来のCISCアーキテクチャと比較すると、前者は高い処理能力を要求するさまざまなアプリケーションにより適応しやすいです。 ロイヤリティフリーのチップ開発の機会 使いやすさが評価される一方で、オープンソースプラットフォームであるRISC-Vはロイヤリティフリーでもあります。歴史的に、半導体設計者はx86やARMに向かい、それぞれの所有者にプラットフォームの使用料を支払ってきました。自由の要素がRISC-Vに多くの賞賛をもたらすことに驚くことはありません。さらに、オープンソースのサポートは、x86やARMでは明らかでない、または利用できないかもしれない能力や設計アイデアへのアクセスを設計者に提供します。 中国対米国:オープンソースISAへの制限 RISC-Vの使用とより高度な技術の開発は、 中国と米国の間の対立によって影を落としています。セキュリティへの懸念だけでなく、EDA市場での競争もあり、米国はRISC-Vに関連するトピックでの米中研究者間の協力を禁止することによって、中国によるRISC-Vの使用を抑制する支援をしています。中国は、英国のARM社や米国のIntel社に代わる代替手段として、RISC-VオープンISAを活用したコンポーネントの研究開発に大きく投資しています。 RISC-Vがチップ供給チェーンに与える影響 米国によって中国に課された制限、新しい設計組織の可能性、ファブレス製造モデルの採用など、RISC-Vがグローバルな電子設計自動化(EDA)供給チェーンに長期的に与える影響を決定する要因はいくつかあります。 OEMはファブレスチップ企業になるのか? RISC-Vのオープンソース性質は、設計チームがISAと設計例にアクセスできるようになるため、サプライチェーンにも変革をもたらす可能性があります。これにより、企業は特定のメーカーに縛られることなく、 より高度なコンポーネントを自社で開発する能力を得ることができます。IntelやTSMCなどからの製造能力へのアクセスが拡大することで、企業はライセンス料の負担が少なく、リスクも低い状態で独自のカスタムチップを製造する大きな機会を得ています。Microsoft、Tesla、Northrop Grummanなどのテクノロジー企業がチップ設計活動を内製化しており、RISC-Vは他の企業にも同様の道を歩むチャンスを提供しています。