統合設計環境

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PCBレイアウトソフトウェア比較に最も重要な機能

PCBレイアウトソフトウェア比較に最も重要な機能 1 min Thought Leadership 掘り出し物を見つけようと思って、中古車販売店に行ったことがありますか? 整備工でもなければ、ほとんど不可能です。私の場合、値段を除いて、自分にはほとんど同じに見える2台の車から選ぶことになりました。安い方を選んで、近くの整備工場に持って行くと、ぽんこつを選んだことが分りました。PCB設計ソフトウェアを選ぶときにも、同じ気持ちになることがあります。無料のプログラムを使用して、または中級のプログラムを購入して、自分が必要とするものには、ほど遠いことが分ったときです。電子設計自動化（EDA）ツールを決める前に、基板の設計に必要な高度な機能をサポートするか、確認する必要があります。また、自分特有のニーズに合うようカスタマイズできる統合環境で、これらの全ての要素が利用できることも重要です。探すべき機能私は、値段だけで車を選びました。もう一方の車と見た目は同じなのに、数千ドル安かったのです。結局、値段相応だと分りましたが、このことは、ECADソフトウェアにも当てはまります。たぶん、PCBの設計に、より安い、できれば無料のソフトウェアを使用したいと考えるでしょう。オプション機能の足りない点が、安い類似ブランドの問題点です。PCB設計が複雑になるにつれて、これらの「オプション機能」が必要になってくるのです。設計プログラムを選ぶ際に探すべきものをいくつか示します。基板サイズ - これは当然ですが、挙げておきます。無料ツールの多くでは、基板スペースが厳しく制限されています。ソフトウェアが、回路に十分なスペースをサポートしているか確認してください。高度なビア設計 - 高密度相互接続（HDI）基板や高速基板などを設計している場合、これは非常に重要です。ブラインドビアやベリードビア、ビアインパッド（VIP）、マイクロビア、バックドリル加工などの使用が必要になります。これらの機能のサポートは、低価格帯のソフトウェアには含まれない場合があります。必要であれば、利用できることを確認してください。レイヤーの数 -

差動ペアと仲良くなる

ディファレンシャルペア回路図との友達作り 1 min Blog 差動ペアを扱う際、特に回路図に差動ペアの指示が追加されていない設計を引き継いだり、インポートしたりする場合に、疑問が生じます。回路図のドキュメントに指示を設定することは実際に必要なのでしょうか？ Altium Designer^® で回路図の差動ペア指示を使用するためには、特定の命名規則を使用する必要があります。ペアの負と正の信号はそれぞれsignalname_Nおよびsignalname_Pの規則に従って命名され、各信号には差動ペアの指示が添付されている必要があります。差動ネット名が+と-や_Hや_Lなど、別の方法で示されていた場合、Altiumが回路図の指示を利用できるように、ネット名を_Nおよび_Pの接尾辞でリネームする必要があります。しかし、より柔軟な命名規則に基づいてPCBエディタで差動ペアを作成する方法があります。必要なのは、回路図上の差動信号に、ペアの正と負のネットを何らかの一貫した方法で定義するネットラベルがあることだけです。回路図上で_P、_Nの規則に従っていたとしても、次の方法を使用すると、回路図に差動ペアの指示を最初に配置することなく、PCBエディタ内で差動ペアを作成できます。 PCB上で名前付き信号から差動ペアを作成するためには、ECOの実行を通じてすべてのネットデータがPCBにロードされていることを確認してください。Design » Update PCB from Schematicsを使用するか、PCB Design » Import Changes from .PrjPcbから選択します。ECOからの変更を実行し、ネットがPCBにロードされます。 PCBエディタで、 View »

回路図設計プロセスで最も一般的なエラーを避ける方法

回路図設計プロセスで最も一般的なエラーを避ける方法 1 min Thought Leadership PCB設計者が回路図設計プロセスで犯すことができるエラーは100以上あります。現在の設計基準レビュープロセスでそれらをすべてキャッチしていますか？最も一般的なPCB設計のミスをより良くキャッチする方法について、読み進めてください。 10年の違い回路図のレビュープロセスは10年前はもっとシンプルで、エラーをチェックするための回路図レビュープロセスは、そんなに多くの人時を要するようには思えませんでした。10年以上経った今、私たちの設計はこれまで以上に複雑になりました。そして、複数の高ピン数デバイスや大きなオンボードおよびオフボードコネクタを含む複雑な回路を設計する際には、製造プロセスにエラーが逃げ込むリスクが大きくなります。そして、私たち全員が知っているその結果が、再設計です。最近、私はAltium Designerと座談会を行い、Valydateで取り組んでいる新技術、スキーマティック・インテグリティ分析チェックについて話し合いました。過去数年間で、私たちはスキーマティック設計プロセスでエンジニアが犯すすべてのエラーから大きな利益を得てきました。これは私たちにとっても、設計者にとっても素晴らしいことです。なぜなら、スキーマティック設計プロセスにどれだけ多くの潜在的なエラーが存在し、それらのうち実際に手動の人間によるレビューで特定されているものがどれほど少ないかについて、ついに明確な理解を得ることができたからです。小さく始める Valydateには興味深い歴史があります。私たちはスキーマティック・インテグリティ分析のためのEDAツールをリリースする意図で始めましたが、その時点ではその種の投資を行うには十分な規模ではありませんでした。解決策は？より小さな投資から始め、サービスベースの提供を通じて技術を開発し、実際のクライアントプロジェクトの評価を通じて私たちの技術を披露することです。うまくいきましたか？ええ、大成功です。クライアントプロジェクトからの報告書が次々と寄せられ、設計者がスキーマティックレビュープロセスで繰り返し犯していた類似のエラーが明らかになりました。その中には、あなた自身が犯しているかもしれないものもあるかもしれません。設計上の欠陥で足場を固める Valydateは、2011年から2012年にかけて数百の回路図に対して回路図検証レポートを作成しました。私たちは、発見した内容を2つのカテゴリーに分けました：重大なエラー。これには、訂正されなければ設計を大きく損なう可能性が高い回路図のエラーが含まれます。欠陥。重大なエラーほどではありませんが、訂正されない欠陥もデバイスの機能喪失を引き起こす可能性がありました。重大な設計エラー私たちは、回路図レビューチェックで見つかった重大で設計を破壊するエラーの種類に驚きました。全体の重大な設計エラーの21%が電源の欠如に関連しており、18%のエラーがネット上に複数の出力があることに関連していました。これらのミスを設計プロセスでしたことはありますか？

DDR3メモリとCPUファンアウトの配線方法

DDR3メモリとCPUファンアウトの配線方法 1 min Blog マイクロコントローラを扱う際、ボード設計者が高エッジレート（高速）のPCB設計を行うことがますます避けられなくなっています。Freescale iMX6マルチコアARMデバイスファミリーのようなCPUの力を借りて、非常に低い「コストパーミップ」で、このようなデバイスを使用して製品に豊かなソフトウェアとユーザーエクスペリエンスを提供することがますます望ましいです。しかし、これらの超マイクロ追加メモリコントローラを使用することは、DDR3レイアウトガイドラインを持つ高速で密度の高いメモリインターフェースの課題を伴います。このゲストブログでは、Altium DesignerユーザーであるFedevel AcademyのRobert Feranecが、彼のオープンソースハードウェア設計であるiMX6 Rex（コンパクトで強力なシングルボードコンピュータ開発キット）に基づいて、DDR3メモリのルーティングに関する非常に価値のあるヒントをいくつか示しています。 DDR3メモリは非常に普及しているため、プロのプリントボード設計者がそれを使用してルーティングしなければならないボードに直面するのはほぼ避けられません。この記事では、非常に高密度で密集したPCBレイアウトでも、DDR3メモリインターフェースを適切にファンアウトしてルーティングするためのヒントを提供します。 DDR3メモリ設計ルールとシグナルグループすべては、グループ内でDDR3をルーティングするための推奨される高速PCB設計ルールから始まります。DDR3メモリレイアウト中、インターフェースはコマンドグループ、コントロールグループ、アドレスグループ、およびデータバンク0/1/2/3/4/5/6/7、クロックなどに分割されます。同じグループに属するすべての信号は、「同じ方法」でルーティングされることが推奨されます。つまり、同じトポロジーとレイヤー遷移を使用します。図1: DATA 6グループのすべての信号は、「同じ方法」でルーティングされ、同じトポロジーとレイヤー遷移を使用します . 例として、図1 に示されているDDRルーティングシーケンスを考えてみましょう。DATA 6グループのすべての信号はレイヤー1からレイヤー10へ、その後レイヤー11へ、そしてその後レイヤー12へと進みます。グループ内の各信号は同じレイヤー遷移を行い、一般に同じルーティング距離とトポロジーを取ります。 DDRルーティングで信号をこのように扱う利点の一つは、長さ調整（別名、遅延または位相調整）を行う際に、ビアのz軸の長さを無視できることです。これは、同じ方法でルーティングされたすべての信号が、ビアを通る際にまったく同じビアの遷移と長さを持つためです。 DDR3メモリグループの作成

ケーブルアセンブリ用の回路図CAD図面の使用方法：パート2

Schematic CAD Drawingsをケーブルアセンブリに使用する方法：パート2 1 min Blog ケーブルアセンブリ図の設計が必要になることが多いのは電子設計チームですが、多くの場合、高価な専用のケーブリング設計ソフトウェアの使用は手が届かず、過剰です。このケーブル設計ブログシリーズの第2回目では、Sainesh Solankiが優れたケーブルアセンブリ図に使用されるコンポーネントの必要な設計要素を明らかにします（第1部はこちらからアクセスできます）。これらの回路図記号とそれに関連するパラメータやその他の項目は、あなたのケーブリング設計を一貫性があり、最初から正しく行うのが簡単になります。コンポーネントの作成最初のステップは、ケーブルヘッドアセンブリを作成するために必要な情報を集めることです：コネクタヘッドのデータシート。圧着情報と図面。ケーブルデータ。熱収縮データ。ケーブルを組み立てるためには追加のツールが必要になるかもしれませんが、それについては後ほど議論します。現時点では、ケーブルアセンブリの図面を描くために必要なものをメモしています。まず、各コネクタヘッドに対してマルチパートコンポーネントを作成することから始めます。このマルチパートのスキーマティックコンポーネントの最初の部分は、アセンブリ図面のためのコネクタヘッドのグラフィカルな図です。これは組み立て図面のための視覚的表現を提供します。図1. コネクタヘッドの1:1の図マルチパートのスキーマティックコンポーネントの2番目の部分は、多位置コネクタのための従来のIEEE-315スタイルの電気スキーマティックシンボルになります（図2を参照）。この2番目の部分は、接続のネットリストを生成するための電気ピンと図を提供し、後で必要な組み立て後のテスト治具やプログラムを生成できるようにします。図2. コネクタのスキーマティックシンボル最後の部分は、私が「ラインアイテムバブル」と呼んでいるものです（図3を参照）。このバブルは、部品が何であるかをその部品表（BOM）への参照とリンクするために図面上でメモを取るために使用されます。図3. 品目の回路図シンボルこれらは、エディターのコンポーネント内で別々のゲート（またはサブパーツ）に調整されています。各パーツには、ケーブルアセンブリに関する重要な情報があります。その重要性については後ほど説明しますが、今はコネクタヘッドコンポーネントとケーブルコンポーネントの作成方法について話します。コネクタヘッドコンポーネント：

ケーブルアセンブリ用の回路図CAD図面の使用方法：パート1

ケーブルアセンブリ用の回路図CAD図面の使用方法：パート1 1 min Blog コンピュータ支援のケーブルアセンブリ図面の必要性はしばしば電子設計チームに委ねられますが、多くの場合、高コストの専用ケーブル設計ソフトウェアの使用は手が届かず、過剰です。解決策は？スキーマティックエディターを使用することです！ほとんどの電子エンジニアは、プリント基板の設計がケーブルアセンブリによって相互接続される必要がある製品に取り組んでいます。すでに気づいているかもしれませんが、ケーブルアセンブリの設計に主に焦点を当てた専用ツールは、強力ではありますが、非常に高価で、単純なケーブル設計プロセスの作成の範囲を超えています。彼らが重点を置いている業界のほとんどは、自動車、HVAC、航空宇宙企業です。では、最良の代替手段は何でしょうか？答えは目の前にあります、ECADツールを使用してケーブルアセンブリ設計のスキーマティックを作成してください！ Altium Designer^® で作業するとき、私はツール内でできることすべてを認識しています。スキーマティックレイアウトとプリント基板レイアウトを作成でき、多くの方法でライブラリを管理でき、バージョンコントロールを通じて文書ソースを制御できます。しかし、心に浮かぶ他の質問もあります： W ケーブルを通じてどのようなルーティング接続が行われるかを決定する設計を作成したい場合はどうすればいいでしょうか？ケーブルハーネスの図面を通じて、信号がどこに行くのかを自動的に追跡するにはどうすればいいですか？そして、ケーブル設計ソフトウェアとドキュメントはどのように役立ちますか？作業現場用の詳細なケーブル組立図を迅速かつ効果的に生成するにはどうすればいいですか？ ? その答えは、Altium Designerの回路図エディターを使用することです！DXF/DWGファイルのインポートを支援することで、非常に詳細なケーブル図面やワイヤーハーネス製造システムを生成することができます。例えば、組み立てに必要となるコネクタヘッドや圧着端子の機械図面をインポートすることができます。この方法では、組み立て者がケーブルを組み立てる際に参照するリアルな図面を持つことができます。以下はそのようなケーブル図面のサンプルです：図1。ケーブル組立図の例。例としてこちら（図1 を参照）に、スケール長さの機械ケーブルハーネス図面があり、両端に1:1サイズのコネクタが二つあります。機械図面の下には、コネクタ用の回路図シンボルを使用し、ワイヤーハーネスで接続された回路図表現があります。この回路図シンボル図内では、ネットラベルが各接続にリンクされているのがわかります。矢印付きのバブル（リーダーノート）は、部品表内で参照できる項目を表しています。組立てノートを書き終えたら、準備が整った図面をケーブルを製造する組立て工場に送ることができます。自分自身の実務経験と、他の仕事仲間との協力を通じて、Altium Designerの回路図でこれらのニーズに対応するための頑丈で強力なケーブル組立て設計コンポーネントの方法論を考案しました。したがって、このブログシリーズを通じて、皆さんに共有したいことは：ケーブル組立て図の構成要素としてのレイアウトの生成方法。

カスタムNanoBoard周辺ボードの設計

カスタムNanoBoard周辺ボードの設計 1 min Blog NanoBoard^®にカスタムハードウェア機能を追加したい場合は、独自のアドオン周辺機器ボードを作成してみてはいかがでしょうか？この2部構成のテックチップでは、Altium Designer^®を使用して独自のカスタムボードを簡単に作成する方法について詳しく説明します。第1部：独自の周辺機器ボードテンプレートの作成この2部構成のテックチップの第1回目では、PB30リファレンスデザインを始点として、PCB設計を進める方法について見ていきます。それを変更して独自の周辺機器ボードのテンプレートを形成します。それとともに、カスタム周辺機器用の利用可能なIO接続についても議論します。次回では、登録プロセスと、作成した新しい周辺機器ボードを使用してFPGA設計を始める方法について説明します。 NB2とNB3000は、多くの工学部、個人、企業の設計チームによって、新しい設計アイデアを探求し、実現するために使用されています。 NB3000は、手頃な価格だけでなく、USB（ホストおよびスレーブ）、RGB LED、TFTタッチスクリーン、絶縁リレースイッチ、ADC、DAC、RS-485、RS-232、Ethernet、MIDI、SVGA、高解像度オーディオIOなど、豊富なIOデバイスとオプションのおかげで特に人気があります。 NanoBoardsは、追加のIO機能を追加するための周辺ドーターボードの位置を持つ拡張可能な開発ボードです。このテクニカルチップを書いている時点で、Altiumからは4つの周辺ボードが利用可能です：フルサイズのPB01（オーディオコーデック、アナログビデオIO）、PB02（SD、CF、ATAなどの大容量ストレージボード）、PB03（Ethernet、USB、IrDA）、そしてNB2/NB3000への必要なコネクタと複数の異なるプロトタイピングエリアを備えたフルサイズのPB30です。プロトタイピングボードは、NanoBoard NB3000への接続を持つ簡単な回路を試すための素晴らしい出発点ですが、独自の周辺ボードを設計することで、無限の可能性が得られます。この2部構成のテックチップの第1回目では、PB30リファレンスデザインから始めて、カスタム周辺ボードのテンプレートを形成するためにそれを変更する方法について見ていきます。それとともに、カスタム周辺機器用の利用可能なIO接続についても議論します。次回では、登録プロセスと、作成した新しい周辺ボードを使用してFPGAデザインを始める方法について話し合います。周辺ボードファイルの準備最初のステップは、周辺ボードのテンプレートを構築することです。このテックチップでは、Altium Nanoconnectorが左上にあり、NanoBoard NB3000に接続されたときにシルクスクリーンが一般的に正しい向きで表示されるように、このボードがPB30を基にしています。NanoBoard NB2を使用している場合、フルサイズの周辺ボードスペースは上部に位置しており、その場合はPB-01（オーディオ、ビデオ）ボードが良い選択肢です。なぜなら、その向きは180度回転しているからです。 Altiumの現在のリリースでは、PB30リファレンスデザインのデフォルトの位置は「C:\Program Files\Altium Summer