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シミュレーションと解析

シミュレーションと解析は、回路図ではプリレイアウト、完成した物理設計ではポストレイアウトで実行できます。Altium Designer には、SPICEシミュレータ、反射やクロストークのシミュレータ、サードパーティのフィールドソルバとの統合など、両方の領域で成功するためのリソースが含まれています。シミュレーションツールの使用や設計における電気的挙動の解析については、ライブラリのリソースをご覧ください。

Altium DesignerのSPICEシミュレーション How to: Simulation and Analysis Circuit Simulation Documentation
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PCBトレースのインダクタンスと幅：どれくらい広いのが過ぎるのか？ PCBトレースのインダクタンス計算：どれくらい広いのが過ぎるのか？ 1 min Blog PCB設計者 シミュレーションエンジニア PCB設計者 PCB設計者 シミュレーションエンジニア シミュレーションエンジニア トレースを正しくサイズ設定し、PCBトレースのインダクタンスが十分に低いことを確認する方法は次のとおりです。 記事を読む
高電圧設計におけるIPC-2221計算機の使用 高電圧設計のためのIPC-2221 PCBクリアランス計算機の使用 1 min Blog PCB設計者 電気技術者 PCB設計者 PCB設計者 電気技術者 電気技術者 PCB設計およびアセンブリの規格は、生産性を制限するものではありません。代わりに、複数の業界にわたって製品設計と性能の統一された期待値を作成するのに役立ちます。特定の設計用の計算機、監査や検査のプロセスなど、ツールはコンプライアンス向けに標準化されます。 高電圧PCB設計において、PCB設計の重要な一般規格はIPC-2221です。多くの重要な設計的側面がこの設計規格にまとめられており、そのいくつかは単純な数式に要約されています。高電圧PCBの場合、IPC-2221計算機を使用すると、PCB上の導電要素間の適切な間隔要件をすばやく判断できます。これにより、次の高電圧基板が動作電圧で安全に保たれるようになります。設計ソフトウェアにこれらの仕様が自動化された設計ルールとして含まれている場合、生産性を維持し、基板を構築する際のレイアウトの間違いを避けることができます。 IPC-2221とは IPC-2221（2012年発効のレビジョンB）は、多くのPCBの設計的側面を定義する、一般的に受け入れられている業界規格です。例えば、材料 (基板やメッキを含む)、試験性、 熱管理とサーマルリリーフ、 アニュラリングなどに関する設計要件が挙げられます。 一部の設計ガイドラインは、より具体的な設計規格に取って代わられています。例えば、IPC-6012とIPC-6018は、それぞれリジッドPCBと高周波PCBの設計仕様を提供します。これらの追加規格は、一般的なPCBのIPC-2221規格とほぼ一致するように意図されています。 ただし、IPC-2221は通常、製品の信頼性や製造歩留まり/欠陥を評価するために使用される認定規格ではありません。リジッド基板の場合、IPC-6012またはIPC-A-600のいずれかが、製造されたリジッドPCBの認定に通常使用されます。 IPC-2221B 高電圧設計における導体スペーシング 高電圧PCB設計の重要な設計要件は、IPC-2221B規格で指定されています。これらの1つは導体クリアランスであり、次の2つの点に対処することを目的としています。 高電界強度でのコロナまたは絶縁体破壊の可能性 樹枝状成長と呼ばれることもある導電性陽極フィラメント形成の可能性（ 下記参照） 最初のポイントは、PCBの導体間に適切な最小クリアランスを設定することで最も簡単に制御できるため、最も重要です。2番目の影響は、適切な配線間隔、 材料の選択、処理での一般的な清浄度によっても抑えることができます。これらの影響を防ぐために必要な間隔は、IPC-2221規格の2つの導体間の電圧の関数としてまとめられています。 下の画像は、IPC-2221規格の表6-1を示しています。これらの値は、2つの導体間の電圧の関数として最小導体間隔を示しています。これらの値は、導体間のピークACまたはDC電圧のいずれかで指定されます。IPC-2221では、500Vまでの電圧に対して固定された最小導体間隔値のみを規定していることに注意してください。2本の導体間の電圧が500Vを超えると、下表に示す電圧ごとのクリアランスの値を用いて、最小導体間隔を計算することになります。500Vを超える各電圧は、表の一番下の行に示されている量だけ、必要な最小クリアランスに追加されます。 高電流時の温度上昇 すべての高電圧PCBが高電流で動作するわけではありませんが、高電流を使用するPCBは、導体の大きさが十分でない場合に高温上昇になる可能性があります。PCBの温度上昇は、導体のDC抵抗に関連するジュール熱によって発生します。したがって、高電流を流す導体の断面積は、電流も大きい場合は大きくする必要があります。 記事を読む
電源プレーンリターンパス パワープレーンとグラウンドプレーン：PCBのパワープレーンをリターンパスとして使用すべきですか？ 1 min Thought Leadership 電源プレーン（電源層とも呼ばれる）とグラウンドプレーンは、電力供給の配布以上の重要性を持っています。インピーダンス制御ルーティングでの基準プレーンの定義や、リターンパスの管理においても、スタックアップはリターン電流がPCBの電源プレーンに入り、その後グラウンド層に再結合されるよう強制することがあります。インピーダンス制御トレース幅の基礎としてGND基準層を定義しても、設計内の電源層の長さに沿った明確なリターンパスを定義する必要があります。電源層をリターンパスとして使用するPCB内でのリターンパスを制御するための良い実践をいくつか見てみましょう。 PCBの電源プレーンをリターンパスとする場合の信号挙動 「リターンパス」と言うとき、設計内でリターン電流が自然に従うパスのことを指します。このパスにより、電流はPCBアセンブリの入力側の低電位端子に戻ることができます。伝送線上で移動する信号にとって、リターンパスは線とその基準プレーンの間の容量によって決まります。容量が大きい、周波数が高い、またはその両方である場合、リターン電流は変位電流として容易にグラウンド層に入ることができます。 これは、伝送線とその参照平面との距離が、その参照平面のタイプが何であれ、実際の設計においていくつかの重要な電気的振る舞いを決定することを意味します。そのような振る舞いには、 外部ソースからのEMI感受性があり、これは大きな電流ループを介して誘導的に、または電場を介して静電容量的に受信されることがあります 不一致のインピーダンスは、平面領域間、ギャップを越えて、またはインターコネクトに沿ってトレース幅が変化する場合に生じます 他のトレースからのクロストークは、設計が 伝播中の損失は、伝送線と近くの参照平面または他の導体の間の場の線の集中によって発生します 返り経路または信号参照を提供する隣接層としてパワープレーンまたはグラウンドプレーンのどちらを使用するか選択できる場合は、常にPCBグラウンドプレーンを選択するべきです。これには2つの理由があり、以下で詳しく説明します。 静電容量結合 電力プレーンがどのようにして（あるいはしないで）任意の種類のリターンパスとして機能するかを議論する前に、我々は次の質問をしなければなりません。伝送線から電力プレーンPCBへの電流はどのようにして入るのでしょうか。答えは、容量性結合です！上述のように、リターンパスは伝送線と近くの導体の間で誘導されることが記されています。近くのプレーン層については、線とプレーンの間に電気ポテンシャルが変化するたびにこれが発生します。したがって、プレーンの隣でトレースが配線され、デジタル信号がそのトレースを通過するとき、我々は今、プレーン層で変位電流が駆動されていることになります。 近くのプレーンが、電力入力時の低ポテンシャル点と同じポテンシャルのグラウンドプレーンであれば、全てがうまくいくでしょう。これの問題点は、電流が電力プレーンから近くのグラウンド層へと移動する必要があるとき、電流は別の誘電体層を通ってPCBグラウンドプレーンに到達する必要があるということです。 スタックアップの設計方法や信号が誘導される基板の領域によって、2つの層の間のキャパシタンスは、電源プレーンとグラウンドプレーンの間に非常に高いインピーダンスの経路を形成する可能性があります。スタックアップによっては、以下に示すような単純な4層スタックアップの場合、電源層とPCBグラウンドプレーン層の間のプレーンキャパシタンスは非常に小さく（平方ミリメートルあたりフェムトファラドのオーダー）、非常に高速なデジタル信号や非常に高周波のRF信号を除いて、極めて高いインピーダンスのリターンパスを作り出します。この電源プレーンとグラウンドプレーンの間の旅の中での唯一の他の選択肢は、以下に示すように、最も近いデカップリングキャパシタを通ることです。どちらの場合でも、基板のどこかでEMI問題が発生する可能性があります。 通常の低速シングルエンド信号（たとえば、立ち上がり時間が制限されたI2CやSPI信号など）の場合、このGNDへの結合から発生するEMIが最大の問題ではないかもしれません。これは、純粋なDCや低周波アナログデバイスではまったく発生しません。しかし、今日の標準CMOSコンポーネントでは、一般的なデジタルコンポーネントのシングルエンドバスでもこの問題が発生する可能性があります。では、解決策は何でしょうか？ 解決策は、PCBスタックアップの再設計にあります。最も簡単な方法は、グラウンドリターンを提供するレイヤーを追加することです。一般的に、すべてのGNDプレーンが適切に間隔を置いてステッチングビアで繋がれている限り、他の設計変更は必要ありません。設計の観点からより時間がかかるものとして、上記の4層スタックアップのように、PWRとシグナルを同じレイヤーに配置し、その上にPWRをプアとして同じレイヤーに追加することが挙げられます。 4層例 上記の例の4層ボードでは、連続したビットストリームを提供する必要があるバスとラインを、GNDの直上のトップレイヤーに配置するのが最適です。RCやシリーズ終端で遅延させることができる制御信号などの他の信号は、バックレイヤーに配置することができますし、その他のサポートコンポーネントも同様です。しかし、両方の表面レイヤーにデジタルバスを持つ4層PCBが必要な場合、最良の実践は代替スタックアップを使用することです。 このスタックアップは、ノイズを抑制し、どこでもクリアなリターンパスを提供する最良の代替手段と言えるでしょう。これはSIG+PWR/GND/GND/SIG+PWRスタックアップで、信号と電力は上層でルーティングされます。これにより、電力レールは隣接するGNDプレーンに近接して配置されるべきであるため、非常に強力なデカップリングが提供されます。 この代替4層スタックアップについてもっと学ぶ このボードには、複数の電力レールがある場合に生じる可能性のある難しさが一つあります。4層ボードが両層に高速信号を必要とし、複数の電力レールと強力な電力整合性が必要な場合、標準のSIG/GND/PWR/SIGスタックアップは機能しません。ここで、2層を追加して6層スタックアップを構築することが最良の選択です。 記事を読む
ファイバーウィーブ効果が高周波信号の整合性に与える影響 ファイバーウィーブ効果が高周波信号の整合性に与える影響 1 min Blog トレースの向きを決め、適切な織り方を選ぶことで、ファイバーウィーブ効果を補償することができます。高周波での共振に注意してください。この最新のPCB設計ブログでさらに詳しく学びましょう。 記事を読む
直交トレース配線PCB 多層PCBにおける直交トレース配線の長所と短所 1 min Blog 直交トレースルーティングの使用を制限する要因は何ですか？ほとんどの設計の質問と同様に、それは信号速度、スタックアップ、そしてPCBレイアウト内の配置に依存します。専門家であるZachariah Petersonによる最新のPCB設計ブログを読んで、さらに詳しく学びましょう。 記事を読む
アルティウムとSimberian社のパートナーシップにより成長を続ける高速設計機能 アルティウムとSimberian社のパートナーシップにより成長を続ける高速設計機能 1 min Thought Leadership アルティウム社員一同より新年のご挨拶を申し上げます! 今年最初の記事では、Simberian社の営業およびマーケティング責任者であるRoger Paje氏に、最近締結された当社との正式なパートナーシップについて、またSimberian社の高精度フィールドソルバーテクノロジーによるAltium Designerのレイヤースタック、インピーダンス、表面粗さのモデリングなどの新しい高速設計機能の導入支援についてのお話を伺います。これらの拡張機能はAltium Designer 19で初めて搭載され、Altium Designer 20で強化されました。今後はさらに多くの機能が搭載されることをご期待ください。 Judy Warner: Rogerさん、Simberian社について、そして同社でのあなたの役割についてお聞かせください。 Roger Paje: 弊社は、PCB構造、および基板のシグナルインテグリティー解析のための電磁シミュレーション ソフトウェアを開発しています。当社の使命は、技術パートナーと共に、実際の現場での測定により検証された正確な結果を技術者に提供することです。営業、およびマーケティング責任者としての私の役割は、お客様とシグナルインテグリティーコミュニティーとも協力して、設計が最初から機能するように検証できるソフトウェアを作成することです。 Warner: 最近、アルティウムとSimberian社は正式な提携を発表しました。その内容と、PCB設計者がAltium Designerで引き続き実行できることについてお話しいただけますか? Paje: アルティウムとSimberianの提携で重点的に取り組むことはただひとつ。より多くの技術者が正確なシグナルインテグリティー解析を利用できるようにすることです。これは、PCIe 記事を読む
DDR5 PCB設計と信号整合性：設計者が知っておくべきこと DDR5 PCBレイアウト、ルーティング、およびシグナルインテグリティガイドライン 1 min Guide Books PCB設計者 電気技術者 PCB設計者 PCB設計者 電気技術者 電気技術者 DDR5規格のリリースが2020年7月に発表されました。これは、提案された規格に従う最初のRAMモジュールの開発が発表されてから約18ヶ月後のことです。この規格では、ピーク速度が5200 MT/秒/ピンを超えることが可能であり（DDR4の3200 MT/秒/ピンと比較して）、JEDECで評価された速度は最大6400 MT/秒/ピン、チャネル帯域幅は最大300 GB/秒まで増加します。 この新世代のメモリは、8GB、16GB、32GBの容量で、技術がより商業化されるにつれて、以前の世代よりも需要が上回ると予想されます。 より高速な速度、より低い供給電圧、そしてより高いチャネル損失は、DDR5のPCBレイアウトと設計において厳格なマージンと許容誤差を生み出しますが、DDR5チャネルの信号整合性は一般的な信号整合性メトリクスを用いて評価することができます。この分野には取り上げるべきことがたくさんありますが、この記事では、DDR5における信号整合性を確保するための重要なDDR5 PCBレイアウトおよびルーティングガイドライン、およびDDR5チャネルにおける重要な信号整合性メトリクスに焦点を当てます。 DDR5アイダイアグラムとインパルス応答 DDR5チャネルの信号整合性を調べるために使用される重要なシミュレーションには、アイダイアグラムとインパルス応答の2つがあります。アイダイアグラムは、シミュレートすることも、測定することもできますし、終端されたチャネルでのインパルス応答も同様です。どちらもチャネルが単一ビットおよびビットストリームを伝送する能力を測定し、チャネルの解析モデルが因果関係の観点から評価されることを可能にします。以下の表は、これらの測定/シミュレーションから得られる重要な情報をまとめたものです。 インパルス応答 アイダイアグラム 測定内容 単一ビット応答 ビットストリームへの応答 測定から判断できること - チャネル損失 (S21) - 記事を読む