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PCB設計
わずか4つのステップで電源分配ネットワークを最適化する方法
最近の設計者は、電源分配ネットワーク( PDN )インテグリティという、従来考える必要のなかった問題に直面しています。私たちは皆、何十年もの間、シグナルインテグリティーの必要性を感じてきましたが、その間、パワーインテグリティーは、脇に置かれてきました。従来は、専用の電源プレーンを使用するスペースが多くありました(動作に必要なものをデザインに容易に含めることができました)。 しかし、設計の物理的な制限を押し広げ、より小さなフォームファクターに、より多くのコンポーネントを詰め込み続ける中、フォームファクターの縮小を続けながら PDN を最適化する方法が必要となっています。物理的な試作やシミュレーションのエキスパートに頼らないで、設計環境で直接、電源プレーンの形を最適化できれば、どうでしょう ? PDN Analyzer powered by CST
®
は、 Altium Designer ワークスペース内で PDN インテグリティーへの道を提供します。従来は非常に長く骨の折れた解析プロセスを
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PCB設計に影響を及ぼすDFMの課題トップ3
SMDコンポーネントパッド間の均一な接続の作成 PCBの設計者は、さまざまな要件を満たしながら期待に応えなければなりません。検討の対象となる領域は、電気、機能、機械に及びます。また、最高品質のPCBレイアウトは、できるだけ低コストで期日までに完成させる必要があります。こうした要件への対応にあたっては、DFM(製造を考慮した設計)も考慮に入れる必要があります。DFMはPCBの設計プロセスの重要な要素であり、適切に対応されていない場合は高い頻度で問題が発生します。PCB設計に影響を及ぼす3つのDFMの課題を見ていきましょう。 #1 - コンポーネントパッドの均一な接続 0402、0201、またはそれ以下のサイズのSMDコンポーネントについては、パッドの接続を均一にすることが重要です。これによって、ツームストーニング(コンポーネントがリフロー中に基板から部分的に、または完全に外れてしまうこと)を回避できます。また、確実なはんだ付けを行うには、BGAパッドとも均一な接続を維持することが重要です
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レイヤースタックを初めから間違えないようにする方法
PCBの製造工程で最も犯しやすい間違いの1つは、層の順序の誤りです。 確認しないままにしておくと、全工程が無駄になる場合があります。 PCB実装工程を経た製品は、電気的導通の観点からは機能するかもしれません。電気的に導通していれば、電気的検査にも合格するかもしれません。しかし、 プレーンや信号層の順序と層間の距離を最優先にしている設計では、最終的な実装段階で障害が発生します。この問題を予防するにはどうすればよいでしょうか ? 詳細な方法 正しい順序で積層し、後工程外観検査を行うために必要な情報を製造業者に確実に伝えるには、そうした情報を銅パターンとして直接設計に組み込んでおく必要があります。これらのパターンを設計に含め、最終的な実装の検査のための機構を提供するのは PCB設計者の責任です。該当するのは、以下の機能です。 他の全てのレイヤーと関連付けて定義された番号割付方針によりレイヤーを正確に識別する。 レイヤーの順序を目視で簡単に検査できるよう積層ストライプを追加する。
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テストまたはDFTの設計に成功する方法
プリント回路基板が完成するまでにかかる全コストは、ブランクPCBの製造コスト、コンポーネントのコスト、実装コスト、テストのコスト、のように複数の基本カテゴリに分類できます。最後に出てきた、完成した基板をテストするのにかかるコストは、製品全体の合計製造コストの25%から30%を占める場合があります。 テストカバレッジを最大化し、PCB製造エラーおよびコンポーネント障害に関する欠陥を迅速に分離できるよう、製品を設計することによって、DFTは収益性のある設計として最高のものとなります。基板のテストカバレッジを確実に最大化するために、従うべき設計の最善の方法はいったい何なのか? 確認してみましょう。 いつでも事前に計画する 設計を計画するときに聞く最初の2つの質問は次のとおりです。 誰が実装をテストしますか? 機能は何ですか? DFTガイドラインは最初のレイアウトの計画で役に立ちます。しかしながら、契約製造元(CM)に直接連絡して
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サプライチェーン管理: 設計時のコンポーネント在庫状況の確認
包括的データ管理の全体像 コンポーネントの在庫状況を把握していないために、製品の遅延、製品投入時期の逸失、さらには製品が製造不可能になることもあります。設計上のその他のあらゆる課題に加えて、必要なときに実際に在庫があるコンポーネントを選択していることを確認する必要があります。既存の設計について再発注や変更を行うときは、どうすればいいのでしょうか? 必要なコンポーネントがまだ購入可能かどうか、どうすれば確認できるでしょうか? エンタープライズ向けソリューションから、人手によるスプレッドシートでの追跡まで、多くの異なるデータベースや手法が存在します。コンポーネントにライブのサプライヤーデータが直接追加され、この情報を即座に参照できれば素晴らしいと思いませんか? Aberdeen Groupによると、優良企業の81%が一元的に構築され管理されているライブラリシステムを使用しています 1 。このようなシステムにアクセスできると、データベースを参照し、その情報に基づいて選択することができます
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知っておくべき上位5つのPCB設計基準
アルティウムは、確実に基板が意図した通りに作動するように全ての設計者が知るべき必須の基板レイアウトガイドラインを編纂しました。業界を主導するエキスパートが執筆しています。
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トレーニングは必要か? 疑問の余地はまったくなし
Altiumの製品の新しいユーザーや使用頻度の低いユーザー、利用を検討中の見込み顧客に対し、私はよくこう尋ねます。「トレーニングは計画されていますか」案の定、この質問を聞いた人たちは表情が硬くなり、ためらいがちに「そうしたいのですが…」と答えます。そして大半は、仕事の中断やトレーニングなどにかかる費用など、いくつかの問題点を口にします。こうした反応は、歯医者に行くかどうか考えているときと似ています。つまり、行くのを引き延ばしていると、とんでもないことになるのはわかっていても、仕事に穴を開けて歯医者に向かい、嫌な治療を受けてお金まで払わなくてはなりません。 それと同じように、「トレーニングを受けるかどうか」という決断を後回しにしているうちに、お決まりの言い訳が頭をもたげます。「今手掛けている重要なプロジェクトから抜けることはできない」、「経営陣から費用について質問攻めにされるだろう」、あるいは、「単なるEDAツールなのだから
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回路図の電気的ルールチェック
はじめに このホワイトペーパーは、PCB設計のプロセスにおいてあまりに重要視されていない機能について解説するものであり、最初から適切な方法で設計を進めるための情報が提供されています。多くの設計者や企業はPCBのレイアウトを正しく設計することに取り組んでおり、最近では周辺の機械に関する状況をリアルタイムでチェックしています。 しかし、既に回路図にエラーが含まれる場合は、どうでしょう?通常、人による設計のレビューが行われますが、設計の複雑さが増し納期が短くなる中、ミスが入り込むことが、ますます普通になっています。プロ向けのPCB設計ツールのエレクトロニックルールチェック(ERC)機能は、回路図のミスを見つけ取り除くのに役立ちます。いくつかの基本ルール、および設計の基となる「文法」をチェックします。 ERC(電気的ルールチェック)はなぜ有効なのか この質問に答えるのは非常に簡単です。つまり、設計を対象としたチェックを行うルールを設定するだけで問題が特定され
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正確な出力ジョブファイルを使って設計の意図を伝える
以前のブログ記事 では、実装図面や製造図といった専門的な PCB 設計文書がいまだに手動で作成されていること、そして Altium の Draftsman などのツールを使って、そのプロセスをどう自動化できるのかについてご紹介しました。残念ながら図面の作成は、完成した設計文書を製造部門にリリースする際に、設計者が直面する難題のひとつに過ぎません。部品表、ガーバーやドリル、 ODB++ などの実装ファイルのほか、回路図ページのプリントといった膨大な量のドキュメントや製造ファイルの出力作業も待っています。実際のところ、 2017 年に発生する手動作業の分量は予想よりも増えています。これを自動化してくれるソフトウェアを使って、仕事を効率化する手がないでしょうか。 正確な出力ジョブファイルの重要性 設計の意図を正しくはっきりと製造部門に伝えるには、正確な出力ジョブファイルを提供することが極めて重要ですが、出力ファイルを手作業で作成するのは面倒で厄介な作業です
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回路図とPCBレイアウトの同期によって効率と納期順守を改善
画像ソース: Flickr user bittbox ( CC BY 2.0 ) しばらく前に、私は、スマート潅漑と環境モニタリングを自動化するためのシステムを設計、設置する会社で働いていました。業務に特有のニーズに対応するため(または、製造業者から戻ってきた後に、特定のモデルでの設計の欠点や見落としを補正するため)、どたん場で基板に「ハック」(ピンスワップやゲートスワップなど)を行うのが習慣になっていました。この即席の方法は、短期的には効果があり、その会社は、プロジェクトから期待された要件を必ず満たすことができましたが、この「直感に頼る」方法には、拡張性がありませんでした。 問題の一部は、 PCBレイアウト の微調整に時間を使いすぎて(製造業者から基板が戻ってきて初めて、一部の詳細を無視していたことに気付いたのです)、詳細な回路図を通じて設計に全体的にアプローチするための時間が十分になかったことです。統合データモデルによるアプローチについて私たちが知っていれば、その時
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デザインルールによるコンポーネントの電力定格の最適化
私は、自分が最初に設計した回路が認定に失敗したことを今でも覚えています。それは証明済みの設計で、既に以前の認定に合格していたものなので、テストが失敗したことをマネージャーから聞かされたときには非常に驚きました。「火がついた」と噂が広まりました。電子回路が実際に発火することは稀です。ほとんどの場合は、多少煙が出るだけです。どちらにしても、PCB上の焼け焦げが事実を物語っていました。トランジスタが過熱し、暴走して発煙したのです。しかし、なぜそのような結果になったのでしょうか? それは証明済みの設計でした。何が変わったのでしょうか? 簡単な調査の結果、回路は同じであることが証明されました。同じコンポーネントで、同じ入出力で、ロットや製造業者さえも同じでした。1つだけ変化したのはレイアウトでした。私がこの基板をレイアウトしたとき、機械的アセンブリの部品の周囲に収まるよう、フォームファクターを調整する必要がありました。パワートランジスタの周囲の銅箔は、元々は約1平方インチでした。この設計では
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回路図からのプロジェクトライブラリの作成
回路図からすばやくプロジェクトライブラリを作成し共有する 外部の製造業者を使う場合、または社内に設置されたライブラリにアクセスできない他のグループと設計を共有する場合、プロジェクトライブラリを作成するとデータを簡単に共有できます。導入済みのライブラリ、または Altium Concord Pro ライブラリからライブラリを作成しても、サプライヤー検索を使って手動でライブラリを作成したとしても、部品をローカライズして簡単に作成できます。ライブラリを作成すると、外部との共有のためにデザインの移植性を高めることができます。 Altium Designerは、各コンポーネントのプロパティを編集することで、または [Find Similar Objects] コマンドを使いSchematic Inspectorを利用することでライブラリを作成する機能を備えています。しかし、大規模で複数シートにわたる回路図の場合、これらは実用的な方法ではありません。代わりに
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PCB図面の新時代
はじめに ライトテーブル、テープ、マイラーの時代から、PCB設計工程は大きな進化を遂げました。80年代には初となるPCB設計ソフトウェアの発売が開始され、設計制作機能とテクノロジーの新しい時代の幕開けとなりました。それ以来、EDA企業の興 隆、低迷、統合が行われていますが、増え続けるPCB設計の課題に対応するための設計者への助けとなるテクノロジーの進化は変わらずに続いています。 ムーアの法則は真実であり続け、新しいテクノロジー、新しい要求事項は増えるばかりです。私たち設計者は、周波数、コン ポーネントの密度、部品の調達と製造コストの増大に比例するように設計上の制約が急増している現状に対して愛憎入り混じる感情を抱いています。 私たちの要望に基づいて、EDA企業は次世代の自動ルーティング、高速ルーティング、制約管理、コンポーネント情報システ ム、設計の再使用などなど、さまざまな機能を生み出しました。これらすべての新機能により、PCB設計者はあっという間に
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テスト容易化設計
概要 プリント基板が完成するまでにかかる全コストは、ブランクPCBの製造コスト、コンポーネントのコスト、実装コスト、テストのコストのように複数の基本カテゴリーに分類できます。最後に出てきた、完成した基板をテストするのにかかるコストは、製品の合計製造コストの25%から30%を占める場合があります。 収益性を求める設計は、2つの論理的側面から生まれます。1つはDFM(Design for Manufacturability)、つまり最小の欠陥率を維持しながら可能な限り最小の製造コストで製品を開発すること、もう1つはテスト容易化設計(DFT)です。テストカバレッジを最大化し、 製造エラーおよびコンポーネント障害に関する欠陥を迅速に分離できるよう製品を設計することによって、DFTは収益性のある設計として最高のものとなります。この記事では、DFTを詳細に検討し、特にインサーキットテスト(ICT)に焦点を当てます。 DFMおよびDFTガイドライン 委託製造業者(CM)を選択する際は
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レイヤースタックを間違えないようにする方法
はじめに PCBの製造工程で最も犯しやすい間違いの1つは、層の順序の誤りです。確認しないままにしておくと、全工程が無駄になる場合があります。PCB実装工程を経た製品は、電気的導通の観点からは機能するかもしれません。電気的に導通していれば、電気的検査にも合格するかもしれません。しかし、プレーンや信号層の順序と層間の距離を最優先にしている設計では、最終的な実装段階で障害が発生します。 正しい順序で積層し、後工程外観検査を行うために必要な情報を製造業者に確実に伝えるには、そうした情報を銅パターンとして直接設計に組み込んでおく必要があります。これらの銅パターンを設計に含めるのはPCB設計者の責任です。 製造データ内に適切な銅パターンを設計しておけば、積層順序を間違える心配はほとんどなくなります。さらに、社内で品質保証検査を実施し、 工場への投入が可能になった後、これらの銅パターンを使って最終実装検査を行うことができます。 層の識別 各層の銅箔にまず追加するパターンは
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